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電子工程師必備:硬件EMC設計規(guī)范


時間:2017-03-20 作者:
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(6)磁耦合感應的噪聲電壓UNjwB.A.cosojwM.I1,(A為電路2閉合環(huán)路時面積;B為磁通密度;M為互感;I1為干擾電路的電流。降低噪聲電壓,有兩個途徑,對接收電路而言,B、ACOS0必須減?。粚Ω蓴_源而言,MI1必須減小。雙絞線是個很好例子。它大大減小電路的環(huán)路面積,并同時在絞合的另一根芯線上產生相反的電動勢。

(7)防止電磁泄露的經驗公式:縫隙尺寸 < λmin/20。好的電纜屏蔽層覆視率應為70%以上。

 五、接地

(1)300KHz以下一般單點接地,以上多點接地,混合接地頻率范圍50KHz10MHz。另一種分法是:< 0.05λ單點接地;< 0.05λ多點接地。

(2)好的接地方式:樹形接地


(3)信號電路屏蔽罩的接地。


接地點選在放大器等輸出端的地線上。

關鍵詞:電磁干擾 EMC設計 電子 測試測量    瀏覽量:943

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